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1. SDRAM和CPU按照飛線中心對稱處理,兩者間距600-800mil;
2. 數(shù)據(jù)線、控制線、電源線分三類,layout時分組進行,DC創(chuàng)建電源、D0-D7、D8-D15、控制線這4個***class;
3. DR在高速信號(high speed)欄下matched lengths中創(chuàng)建組內(nèi)等長規(guī)則,選擇上述D0-D7、D8-D15、控制線(控制+地址+時鐘)這三個***class創(chuàng)建;
4. 其中線寬和間距滿足特性阻抗50歐姆要求,同時數(shù)據(jù)線組內(nèi)公差100mil,每組走在一起,數(shù)據(jù)線高八位與第八位隔離(不同層),數(shù)據(jù)線與控制線隔離保持20mil距離加地線隔離,控制線組內(nèi)公差200mil,可不同層。
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SDRAM作業(yè).zip
2024-5-8 18:28 上傳
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