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[作業(yè)已審核] 廖凱笛-兩片DDR的PCB設計作業(yè)

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發(fā)表于 2023-7-20 23:32:32 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最后由 cesc 于 2023-7-25 10:35 編輯

作業(yè)心得:
1:對于BGA到DDR的連線方式還需進一步加強練習,實操過程中出現(xiàn)了很多次的調整,到最后還是有一些線繞得比較遠,美觀性不足
2:對于無法實現(xiàn)3W原則的位置可以添加區(qū)域規(guī)則
3:作業(yè)中在繞等長時,地址線修改了三次,每次都是由于先把兩邊的線繞完以后,中間的線空間不足,只能再次從邊上開始修改,浪費了不少時間

DDRX2.brd

1.85 MB, 下載次數(shù): 3, 下載積分: 聯(lián)盟幣 -5

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沙發(fā)
發(fā)表于 2023-7-25 10:35:25 | 只看該作者
沒什么問題
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