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[作業(yè)已審核] 常用存儲器設計兩片DDR(T點)的PCB設計

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發(fā)表于 2022-8-4 23:42:45 | 只看該作者 回帖獎勵 |倒序瀏覽 |閱讀模式
本帖最后由 cesc 于 2022-8-5 09:29 編輯

時間都花在布線走線上,這些做好,其他如等長就容易多了,還要多練習。請老師審核!

DDRX2.brd

1.74 MB, 下載次數(shù): 6, 下載積分: 聯(lián)盟幣 -5

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沙發(fā)
發(fā)表于 2022-8-5 09:27:09 | 只看該作者
這些地方 走線可以滿足3W的區(qū)域要調整下,滿足3W間距
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板凳
發(fā)表于 2022-8-5 09:27:44 | 只看該作者
濾波電容的走線也需要加粗處理
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地板
發(fā)表于 2022-8-5 09:28:08 | 只看該作者
其他沒啥問題,做的挺好的
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發(fā)表于 2022-8-5 09:29:23 | 只看該作者
你提交作業(yè)的時候,寫下你的名字,你的論壇的用戶名也是網(wǎng)名,這樣不知道你是哪個學員
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發(fā)表于 2022-8-5 10:38:10 | 只看該作者
cesc 發(fā)表于 2022-8-5 09:27
這些地方 走線可以滿足3W的區(qū)域要調整下,滿足3W間距

明白,已更新原檔,謝謝老師
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發(fā)表于 2022-8-5 10:39:22 | 只看該作者
cesc 發(fā)表于 2022-8-5 09:27
濾波電容的走線也需要加粗處理

粗心大意了,謝謝點評
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發(fā)表于 2022-8-5 10:40:17 | 只看該作者
cesc 發(fā)表于 2022-8-5 09:29
你提交作業(yè)的時候,寫下你的名字,你的論壇的用戶名也是網(wǎng)名,這樣不知道你是哪個學員

OK,已更新,謝謝!
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