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[作業(yè)已審核] 張自強(qiáng)-一片SDRAM PCB設(shè)計(jì)作業(yè)

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發(fā)表于 2024-3-18 23:56:31 | 只看該作者 回帖獎勵 |正序?yàn)g覽 |閱讀模式
本帖最后由 cesc 于 2024-3-19 15:51 編輯

總結(jié):
數(shù)據(jù)線每9根盡量走在同一層,嚴(yán)格控制3w原則


低八位數(shù)據(jù)組sdram_data_bus:D0~D7,LDQM為一組,等長誤差為±50mil
高八位數(shù)據(jù)組sdram_data_bus:D8~D15,HDQM為一組 等長誤差為±50mil
地址線,控制線,時鐘線設(shè)為一組 等長誤差為±100mil


SDRAM-zhangziqiang.brd

1.16 MB, 下載次數(shù): 1, 下載積分: 聯(lián)盟幣 -5

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發(fā)表于 2024-3-19 15:51:19 | 只看該作者
這里也是短路


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發(fā)表于 2024-3-19 15:50:48 | 只看該作者
短路的問題要注意檢查喔


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