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[作業(yè)已審核] 勞超平-DCDC模塊的PCB設(shè)計作業(yè)

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發(fā)表于 2024-7-24 21:13:08 | 只看該作者 |只看大圖 回帖獎勵 |倒序瀏覽 |閱讀模式
本次學(xué)習(xí)作業(yè)心得:

由于第一次接觸allegro,有許多命令都不熟悉,對軟件的操作也不熟練,導(dǎo)致第一次作業(yè)花費的時間有點多,不過對軟件也有一定的熟悉。
對于DCDC模塊電路,所學(xué)習(xí)到的東西很多,老師講解的也很詳細,為了方便自己記憶,將視頻中所講的注意點按自己的方式進行表述:
對于DCDC模塊電路,首先找到電源的輸入路徑/輸出路徑/反饋路徑,并且優(yōu)先對這三個路徑優(yōu)先布局布線,而找到該三個路徑需要對原理
圖進行分析,每次布局都應(yīng)該先對原理圖進行分析,找到哪些部分需要優(yōu)先布局,哪些部分是次要的。其次的配置器件放置在芯片引腳
附近即可,對于布線同樣是符合優(yōu)先的邏輯進行布線(pcb設(shè)計給人的感覺就像是在給定條件下(結(jié)構(gòu)等)挑選中優(yōu)先級較高的器件或者信號進行優(yōu)先
布局,在各種限制中權(quán)衡最終得到一個較為不錯的設(shè)計方法),通過該模塊練習(xí)也得到了另一個啟發(fā)就是可以通過DATASHEET中的PCB layout推薦
來進行布局布線。其次就是存在許多細節(jié)也是很重要的,將這些細節(jié)熟練于心就會逐漸成為自己的經(jīng)驗,總的來說本次作業(yè)學(xué)到很多東西,細節(jié)方面
仍然繼續(xù)積累。

勞超平-DCDC模塊的PCB設(shè)計作業(yè).zip

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發(fā)表于 2024-7-25 14:11:57 | 只看該作者
這個是控制信號,就不用加粗了


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發(fā)表于 2024-7-25 14:12:32 | 只看該作者
其它沒啥問題
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