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本帖最后由 cesc 于 2023-8-14 17:32 編輯
心得體會:
相比較SDRAM的菊花鏈,DDR的T點對我而言要更加復(fù)雜一點,在進行地址信號中間布線的時候還是花費了很多時間,后續(xù)在進行繞等長的時候把AC分成兩組了,繞了很久才發(fā)現(xiàn)問題,在繞等長上也花費了不少時間,在繞等長的時候沒有把全部的DRC處理完成,最后更新DRC才發(fā)現(xiàn)還有DRC的報錯,改了之后又的繞一下等長,這些無用功希望下次更加細(xì)心細(xì)節(jié)不要再犯。
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DDRX2.brd
2023-8-13 17:17 上傳
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