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[作業(yè)已審核] ddr2布線 總結(jié)

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發(fā)表于 2019-7-14 17:11:15 | 只看該作者 |只看大圖 回帖獎(jiǎng)勵(lì) |倒序?yàn)g覽 |閱讀模式
了解bga走線的間距規(guī)則和線寬規(guī)則,以及差分對的走線要求(最小間距4.5mil,電源線寬12-15mil,計(jì)算合適自己的線寬,間距。老師我這邊暫時(shí)不改了,15mil一大堆報(bào)錯(cuò))第一步,寫好規(guī)則,以及class分類。

第二步,扇孔以及合孔(合孔的時(shí)候要么豎著合孔,要么橫著合孔,有的時(shí)候要豎橫合璧,這樣能騰出好多空間放置電容,一個(gè)電源腳一個(gè)濾波電容,最多兩個(gè)。電容太少的可以自己去添加電容或者在底層鋪銅,相當(dāng)于好幾個(gè)電容都連接在一起一起濾波的效果);
第三步,先處理比較密集的地址線。優(yōu)先處理ddr2到排阻地址線。因?yàn)橄旅娴挠捎诘乳L過孔已經(jīng)被固定了。所以只能通過調(diào)整排阻的位置來做到少換層少過孔的原則。而排阻到cpu的地址線我們可以通過調(diào)節(jié)bga過孔來連接
第四步,地址線全部連接好后,我們重新放置電容以及其他管腳的濾波電容,并且打上過孔占位。(還有差分對一定要優(yōu)先處理,放在第三步),連接數(shù)據(jù)線,一定要同層同組。

第五步,等長處理,平面分割。保證完整的電源平面
第六步,正片層大面積鋪地,cotout修剪尖端銅皮,以及電源層PWR內(nèi)縮60

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發(fā)表于 2019-7-14 18:12:04 | 只看該作者
本帖最后由 清風(fēng)落塵 于 2019-7-14 21:19 編輯

已修改合孔

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發(fā)表于 2019-7-15 16:09:19 | 只看該作者
可以的   總結(jié)很好    下次記得吧文件發(fā)上來
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